请教一下全数字PLL

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按照目前的半导体工艺，60nm CMOS，采用标准的数字集成电路设计+流片，能否作出适合RF应用的全数字PLL?

难了点，买ip更快

除了LC-VCO，其他模块完全没问题
全数字锁相环用于RF最大的难点不在于实现，而在于spur，高频信号到了digital，spur到
处跑，很难搞

TDC是最困难的，in-band的量化噪声很高，同样功耗下一般都做不过模拟的

TI那个做adpll的团队搞了那么多年，最后直接关掉了。。。
那个leader也去一个大学当教授去了，还到处当顾问
TI的最后也仅仅是用到Bluetooth等要求稍低的地方，对于celluar之类的，还是不行，听
说是spur的问题

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