高手请指教上拉电源电阻的问题

1.Basic funtion of a Pull up Resistor create a default high state for a circuit,so
it provides no real power,the resistor can set big value,such as 47k-100k.
2. Open collector circuits are sometimes used as output devices are used with pullup resistor,the resistor offen use low value to improve its driver capability ,such as 2k-4k
3.Pull up resistior to make LED work at some current.You can calculate it with ohm law.

yun,用汉语讲才好

上拉电阻连接到什么样的电源电压上，一般原则就是，你的IO口的工作电压是多少，你的上拉电阻就连接到多少伏的电源上。但OC或OD输出，一般可以连接更高电压或更低电压的电源，具体限值以器件的Datasheet规则为准。如果不是OC或OD输出：任何试图通过上拉电阻来转换电平的，都是危险的行为；试图以上拉电阻来提高驱动能力也基本上是无效的。如果需要接高驱动就应该连接Buffer（缓冲门）或三极管之类的来驱动负载。

上下拉电阻：
1、当TTL电路驱动COMS电路时，如果TTL电路输出的高电<WBR>平低于CMOS电路的最低高电平（一般为3.5V），这时就需要在TTL的输出端接上拉电阻，以提高输出高电平的值。
2、OC门电路必须加上拉电阻，以将开关输出改成电平输出。
3、为加大输出引脚的驱动能力，有的单片机管脚上也常使用上拉电<WBR>阻。
4、在COMS芯片上，为了防止静电造成损坏，不用的管脚不能悬<WBR>空，一般接上拉电阻产生降低输入阻抗， 提供泄荷通路。
5、芯片的管脚加上拉电阻来提高输出电平，从而提高芯片输入信号<WBR>的噪声容限增强抗干扰能力。
6、提高总线的抗电磁干扰能力。管脚悬空就比较容易接受外界的电<WBR>磁干扰。
7、长线传输中电阻不匹配容易引起反射波干扰，加上下拉电阻是电<WBR>阻匹配，有效的抑制反射波干扰。
上拉电阻阻值的选择原则包括:
1、从节约功耗及芯片的灌电流能力考虑应当足够大；电阻大<WBR>，电流小。
2、从确保足够的驱动电流考虑应当足够小；电阻小，电流大。
3、对于高速电路，过大的上拉电阻可能边沿变平缓。综合考虑
4. 光耦的上拉电阻还要考虑电流足够大，否则电流小了会影响信号传输
以上三点,通常在1k到10k之间选取。对下拉电阻也有类似道理
高速电路中的终端匹配阻抗也往往用上拉电阻来实现<WBR>，这样的上拉电阻一般阻值不很高，几十欧姆都有的

在数字电路中不用的输入脚都要接固定电平，通过1k电阻接高电平或接地。
1. 电阻作用：
l 接电组就是为了防止输入端悬空
l 减弱外部电流对芯片产生的干扰
l 保护cmos内的保护二极管,一般电流不大于10mA
l 上拉和下拉、限流
l 1. 改变电平的电位，常用在TTL-CMOS匹配
2. 在引脚悬空时有确定的状态
3.增加高电平输出时的驱动能力。
4、为OC门提供电流
l 那要看输出口驱动的是什么器件，如果该器件需要高电压的话，而输出口的输出电压又不够，就需要加上拉电阻。
l 如果有上拉电阻那它的端口在默认值为高电平你要控制它必须用低电平才能控制如三态门电路三极管的集电极，或二极管正极去控制把上拉电阻的电流拉下来成为低电平。反之，
l 尤其用在接口电路中,为了得到确定的电平,一般采用这种方法,以保证正确的电路状态,以免发生意外,比如,在电机控制中,逆变桥上下桥臂不能直通,如果它们都用同一个单片机来驱动,必须设置初始状态.防止直通！
2、定义：
l 上拉就是将不确定的信号通过一个电阻嵌位在高电平！电阻同时起限流作用！下拉同理！
l 上拉是对器件注入电流，下拉是输出电流
l 弱强只是上拉电阻的阻值不同，没有什么严格区分
l 对于非集电极（或漏极）开路输出型电路（如普通门电路）提升电流和电压的能力是有限的，上拉电阻的功能主要是为集电极开路输出型电路输出电流通道。
3、为什么要使用拉电阻：
l 一般作单键触发使用时，如果IC本身没有内接电阻，为了使单键维持在不被触发的状态或是触发后回到原状态，必须在IC外部另接一电阻。
l 数字电路有三种状态：高电平、低电平、和高阻状态，有些应用场合不希望出现高阻状态，可以通过上拉电阻或下拉电阻的方式使处于稳定状态，具体视设计要求而定！
l 一般说的是I/O端口，有的可以设置，有的不可以设置，有的是内置，有的是需要外接，I/O端口的输出类似与一个三极管的C，当C接通过一个电阻和电源连接在一起的时候，该电阻成为上C拉电阻，也就是说，如果该端口正常时为高电平，C通过一个电阻和地连接在一起的时候，该电阻称为下拉电阻，使该端口平时为低电平，作用吗：
比如：当一个接有上拉电阻的端口设为输如状态时，他的常态就为高电平，用于检测低电平的输入。
l 上拉电阻是用来解决总线驱动能力不足时提供电流的。一般说法是拉电流，下拉电阻是用来吸收电流的

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高速电路中的终端匹配阻抗也往往用上拉电阻来实现<WBR>，这样的上拉电阻一般阻值不很高，几十欧姆都有的

<P align=right>+5 RD币</div>
不太明白终端匹配时上拉电阻的作用