官方淘宝店 易迪拓培训 旧站入口
首页 > 仿真设计 > 射频仿真设计学习 > 时钟线和射频线的干扰问题

时钟线和射频线的干扰问题

05-08
本人设计的板子比较小4mm*3mm左右,是DIP封装的,时钟和RF都有,RF信号1GHz左右,时钟60MHz,调试时发现只要插针通过60MHz的孔,RF上就有杂散。咨询了些人,都说时钟线不能打过孔,但是DIP封装不能改,孔肯定有,请问大家还有没有什么好建议缓解时钟和RF的干扰问题。谢谢。

小编可否发张图上来 不太明白你说的意思
你的板子上有时终 还有rf 然后整个板子做成DIP的么?
从电路设计上来说 1GHz的信号 就不能用DIP了 不然肯定会带来杂散的影响

这个图弄不来啊,板子是DIP28的,RF是1脚,CLk是24脚;我也知道这样有问题,但是管壳是定了不能改的,所以说才问有什么好的办法缓解活着解决这个问题。我想问问CLK干扰RF是因为CLK信号过孔后通过GND传播干扰RF的吗?谢谢。

这个还真不清楚 只是以前看资料说 频率高了,器件就不能采用插脚的,插脚的就必然引起干扰,好象是插脚与孔之见会产生寄生电容之类的吧。具体怎么解决 还真不知道 呵呵 如果能把管脚撇弯 焊接在板子上 试一试呢

做了很多实验了,的确不能过通孔,过孔必挂,唉,只有用其他方式引出去了。

RF用别的方法连接就可以了,比如射频连接线

一般来说,只要把CLK和射频线隔开,就不会干扰

Top